El objeto presenta de modo muy básico cómo simular un fichero HDL de tipo Verilog mediante el uso de un simulador multilenguaje Gadea Gironés, R. (2016). Simulación RTL: arranque básico. http://hdl.handle.net/10251/65046
6:16 · 2014
5:09 · 2015
8:39 · 2014